JLCPCB Prüfer

Ein PCB-Designprüfer, der die Herstellbarkeit für JLCPCB validiert und Ingenieure sowie Hobbyisten anleitet, Regeln vor der Fertigung zu korrigieren.

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Über dieses Tool

Das Tool analysiert PCB-Daten, um die Herstellbarkeit für JLCPCB zu prüfen. Es nutzt Standard-Fertigungsdaten und bewertet Beschränkungen wie Leiterbahnbreite, Abstand, Vias, Maskenabstände und Finish-Kompatibilität. Es liefert einen strukturierten Bericht und eine Pass-/Fail-Zusammenfassung.
Grundsätzlich basieren die Prüfungen auf Regeln und beziehen IPC- und JLCPCB-Konkretisierungen. Kernfunktionen umfassen DRC-ähnliche Prüfungen, Ebenenvalidierung, Maskenerweiterung, Via-Größe-Verifizierung und Panelisierungshinweise. Erweiterte Prüfungen decken verirrte Kupferinseln und Randabstände ab, mit Ergebnissen, die sich für schnelles Triaging und tiefere Überprüfungen eignen.
Es unterstützt automatische Anpassungen von Einschränkungen, wenn Eingaben unter den empfohlenen Schwellenwerten liegen, und bietet einen druckbaren oder maschinenlesbaren Bericht für QA-Teams.
Das Tool ist vor der Fertigung konzipiert, ermöglicht iterative Designverbesserungen und kosteneffiziente Entscheidungen.

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Wie man es benutzt

Eingaben bereitstellen: Platinenabmessungen in mm, Kupferdicke in oz oder Mikrometer, Finish-Typ und optionales Gerber ZIP.
Analyse durchführen, um die Fertigungskonformität zu berechnen und Probleme zu kennzeichnen.
Den generierten Bericht für jede Regelkategorie und vorgeschlagene Behebungen prüfen.
Designdaten oder Restriktionen anpassen und neu durchführen.
Ergebnisse-Datei für Unterlagen oder Pass/Fail-Gating exportieren.

Frequently Asked Questions

Finden Sie schnelle Antworten

Welche Eingaben sind erforderlich?

Mindestangaben umfassen board_dimensions, copper_thickness, finish und eine Datenquelle (Gerber ZIP oder geparste Board-Spezifikation). Optional Panelisierung und Regel-Overrides passen den Check an den spezifischen Fertigungsdurchlauf an.

Was validiert der Checker?

Er validiert Fertigungsbeschränkungen wie Mindest-Spurbreite und Abstand, Via-Größen, Bohr-Toleranzen, Maskenabstände und Finish-Kompatibilität, in Übereinstimmung mit IPC-Richtlinien und JLCPCB-Einschränkungen.

Kann ich einen Bericht exportieren?

Ja. Das Tool exportiert einen strukturierten Bericht für QA, Archivierung oder Gateing, im JSON- oder CSV-Format und enthält eine Zusammenfassung sowie detaillierte Problemlisten.

Führt es elektrische Validierung durch?

Nein. Es konzentriert sich auf Fertigungs- und Herstellbarkeitsbeschränkungen; es simuliert keine Signale, Impedanz oder Netzintegrität.

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